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Lattice为低成本FPGA系列推出多协议3.2 G SerDes

近日,Lattice半导体公司为第三代低成本65纳米LatticeECP3 FPGA系列推出一款新品——多协议3.2 G SerDes器件,该器件符合XAUI抖动标准,具有DDR3存储器接口和DSP功能,逻辑单元数为17K至149K。与同类的Virtex和 Stratix元件相比,减少了80 %的静态功耗,动态功耗也降低了50 %。

LatticeECP3 FPGA系列芯片有320个18x18位乘法器,容量达7Mb的存储器,和16个SerDes通道,速率3.2 Gb/s时,每个通道功耗仅90 mW,提供预加重和均衡功能。ispLEVER设计工具套件支持LatticeECP3 FPGA系列。

LatticeECP3 FPGA系列采用256球至1,156球的BGA封装,可选择128位AES解密算法。(25K量时,LatticeECP3-70、67-K LUT单价 $35起——现在至第三季度供货。)


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